Diodes公司的PCIe? 7.0時鐘發生器為下一代AI基礎設施實現低于30fs的抖動

PCI-SIG^® 開發者大會

2026年5月6日至7日

Mission City Ballroom， 12 號展位

圣克拉拉會議中心

美國加州圣克拉拉

加州圣克拉拉 – 2026年5月7日 – Diodes 公司（Diodes）（納斯達克代碼：DIOD）推出 PI6CG33A06，一款六輸出、超低抖動時鐘發生器，旨在滿足PCIe Express^®（PCIe^®）7.0規范需求，同時兼容此前所有世代的PCIe規范。該器件于 PCI-SIG^® 開發者大會上發布，面向服務器、網絡設備、高性能計算（HPC）系統，以及支撐下一代 AI 基礎設施的數據中心平臺。

PI6CG33A06產生精確的25MHz和100MHz參考時鐘，并實現低于30飛秒（fs）的有效值抖動。這顯著低于 PCIe 7.0 規范的最大 67fs要求，且較英特爾^® CK440Q 規范所定義的 80fs 水平實現了大幅提升。這種超低抖動為系統設計提供更大的設計余量，幫助工程師在復雜 PCB 走線與連接器間應對信號完整性挑戰。

該器件為 128.0 GT/s 的PCIe 鏈路提供穩定的參考時鐘，滿足 800G 與 1.6T 網絡及先進 AI 加速器的帶寬需求。在此速度下，精確的時序對于維持數據中心系統的性能與可靠性至關重要。

PI6CG33A06采用 Diodes 專有的低功耗高速電流轉向邏輯（LP-HCSL）技術，并集成終端。與傳統 HCSL 解決方案相比，該方案可將時鐘相關功耗降低至少50%，并減輕高密度 AI 服務器機架的熱負載。高度集成的設計最多可省去 24 個外部電阻，降低物料清單成本，簡化 PCB 布局，并釋放電路板空間，用于散熱或增加計算與存儲資源。

六個輸出中每一個均包含獨立的輸出使能（OE）引腳，幫助設計人員更有效地管理功耗，并更靈活地控制系統運行。該器件支持 Intel CK440Q-Lite 規范，并設計用于現有的服務器時鐘架構，使設計人員能復用經過驗證的系統設計，同時提升時序性能與整體系統余量。

PCI-SIG總裁兼主席Al Yanes表示：“PCIe 7.0規范正將系統性能推向新高度，尤其是在人工智能與高帶寬數據中心應用領域。PCIe 時鐘發生器，包括Diodes的 PCIe 7.0 時鐘發生器，有助于簡化系統集成，以支持這些進步。”

PI6CG33A06 采用 40 引腳、5mm x 5mm VQFN（ZLF）封裝。

如需在 PCI?SIG 開發者大會期間與 Diodes 安排會談，請訪問： https://www.diodes.com/about/news/events/pcisig-2026。

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